下表为状态表
计数脉冲数 二进制数 十进制数
q3 q2 q1 q0
0 0 0 0 0 0
1 0 0 0 1 1
2 0 0 1 0 2
3 0 0 1 1 3
4 0 1 0 0 4
5 0 1 0 1 5
6 0 1 1 0 6
7 0 1 1 1 7
8 1 0 0 0 8
9 1 0 0 1 9
10 0 0 0 0 进位
十进制加法计数器仍由四个主从型jk触发器组成，j,k端的逻辑关系式：
由上述逻辑关系式可得出下图所示的四位同步十进制加法计数器的逻辑图
下图是ct74ls290型二－五－十进制计数器的逻辑图，外引线排列图和功能表。
和是清零输入端，和是置“9“输入端
1)只输入计数脉冲c0,由q0输出，f1-f3三位触发器不用，为二进制计数器。
2)只输入计数脉冲c1，由q3,q2,q1端输出，为五进制计数器
3)将q0端与c1端联接，输入计数脉冲c0。这时，由逻辑图得出各位触发器的j,k端的逻辑关系式：
j0=1 k0=1
j1=q3 k1=1
j2=1 k2=1
j3=q2q1 k3=1
而后逐步由现状态分析下一状态（从初始状态“0000“开始），一直分析到恢复”0000“为止。可知为8421码十进制计数器。